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题名/责任者:

Verilog HDL数字集成电路高级程序设计/蔡觉平 ... [等] 编著

出版发行项:

西安:西安电子科技大学出版社,2015

ISBN及定价:

978-7-5606-3858-4/CNY53.00

载体形态项:

464页:图;26cm

并列正题名:

Verilog HDL advanced digital integrated circuit design

个人责任者:

蔡觉平 编著

个人责任者:

翁静纯 编著

个人责任者:

褚洁 编著

个人责任者:

冯必先 编著

学科主题:

数字集成电路-电路设计-高等学校-教材

学科主题:

VHDL语言-程序设计-高等学校-教材

中图法分类号:

TN431.2

中图法分类号:

TP312VH

题名责任附注:

题名页题其余责任者: 翁静纯, 褚洁, 冯必先

相关题名附注:

英文题名取自封面

提要文摘附注:

本书系统地对Verilog HDL程序设计方法进行说明, 明确了数字可综合逻辑设计和测试仿真程序设计在Verilog HDL语言中的不同, 通过对典型的组合逻辑电路、时序逻辑电路、混合电路和测试程序的设计举例, 较为完整地说明了Verilog HDL语言在数字集成电路中的设计方法。

使用对象附注:

高等学校电子信息类“十三五”规划教材 西安电子科技大学研究生精品教材

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